décodage binaire/afficheurs 7 segments via FPGA+AHDL
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décodage binaire/afficheurs 7 segments via FPGA+AHDL



Mode arborescent

  1. 28/03/2007, 19h15 #4
    Jack
    Modérateur

    Re : décodage binaire/afficheurs 7 segments via FPGA+AHDL

    J'ai vu qu'avec un compteur (lpm_counter) qui se décrémente, on peut controler l'incrémentation d'autres modulo dix de manière à ce que chacun donne en sortie un digit en décimal;

    Dans ce cas, ça veut dire que tu peux travailler en schéma et pas seulement en AHDL.

    A+
  2. Aujourd'hui
    A voir en vidéo sur Futura
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