mémoire ram avec le langage VHDL

**hamza_lahlou** · 26/01/2016, 22h40

Salut,
je veux créer une mémoire de type RAM simple de (8*8) sous le langage VHDL ??
qlqu'un peut me donner un exemple?
merci pour votre aide

**JPL** · 26/01/2016, 22h55

Je n'ai rien compris, mais le bon forum pour le VDHL c'est Électronique. Message déplacé.

**Jack** · 26/01/2016, 23h03

Çà serait bien que tu postes directement dans le forum électronique et pas dans le forum informatique comme c'est pourtant clairement écrit dans les règles participatives de ce forum.

PS: grillé par speedy JPL

**jiherve** · 27/01/2016, 12h30

Bonjour,
il suffit de declarer un type array de la bonne taille et ensuite d'instancier un signal de ce type, cela generera un RAM si le compilateur l'autorise.
Cependant les fabricants de FPGA offrent des "macro" permettant de faire la meme chose il faut chercher dans la doc utilisateur qui va bien.
en inférence :http://quartushelp.altera.com/14.0/m...m_inferred.htm
un exemple d'utilisation de blocs :https://www.altera.com/support/suppo...-ram-sclk.html
JR

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