Bonjour,
J'explique rapidement mon problème: je viens d'écrire un module en VHDL, dans lequel je fais des multiplications. J'utilise un FPGA d'Altera et j'utilise Quartus II pour compiler mon FPGA.
Tout fonctionne bien, mais lors de la synthèse, les multiplications de mon module se font en utilisant des "Logic Elements" et non des "Embedded Multiplier 9-bit elements" (alors que j'en ai beaucoup à disposition..). L'instanciation du multiplieur chez Altera est LPM_MULT mais je ne peux pas l'instancier dans un process ou en tout cas je n'y suis pas arrivé...
Quelqu'un connait-il la solution pour forcer l'outil de synthèse à implémenter mes multiplications en "Embedded Multiplier 9-bit elements" et non en Logic Elements? Peut-on cocher une option ou quoi dans Quartus?
Merci de votre aide!
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