simulation VHDL
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simulation VHDL



  1. 24/05/2009, 08h49 #1
    invitecbaaa007

    Question simulation VHDL


    ------

    A quel endroit dois-je écrire mon testbench ?
    En écrivant un autre programme dans un autre fichier ?
    Dans Xilink ?
    Ou bien dans ModelSim ?
    Urgent , merci .

    -----
  2. 24/05/2009, 13h40 #2
    jiherve

    Re : simulation VHDL

    bonjour,
    dans Modelsim of course!
    JR
    l'électronique c'est pas du vaudou!
  3. 25/05/2009, 13h40 #3
    invitecbaaa007

    Re : simulation VHDL

    Merci A bientot !
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