sinus_vhdl

[elec_cup]

library ieee;
use ieee.std_logic_1164.all;

package sine_package is

  constant max_table_value: integer := 127;
  subtype table_value_type is integer range 0 to max_table_value;

  constant max_table_index: integer := 127;
  subtype table_index_type is integer range 0 to max_table_index;

  subtype sine_vector_type is std_logic_vector( 7 downto 0 );

  function get_table_value (table_index: table_index_type) return table_value_type;

end;

package body sine_package is

  function get_table_value (table_index: table_index_type) return table_value_type is
    variable table_value: table_value_type;
  begin
    case table_index is
      when 0 =>
        table_value := 1;
      when 1 =>
        table_value := 2;
      when 2 =>
        table_value := 4;
...
...
...
when 127 =>
        table_value := 127;
    end case;
    return table_value;
  end;

end;

Puis-je avoir une explication de ces lignes de code ?
==> Je n'ai jamais fais de sinus !!
La rom est-elle utilisée ? Comment fonctionnent les mémoires ?

Cordialement

DELALIN Ambroise
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[Jack]

ca ressemble à l'implémentation d'une rom sinus, une lookup table. Le principe est d'éviter les calculs de la fonction y = sin(x), où x représente l'adresse de la mémoire et y la donnée contenue à cette adresse.

A+

[inviteda3670f6]

C'est pas que une ressemblance
A plus

[jiherve]

Bonsoir,
ceci dit la méthode utilisée pour générer la table est primitive!
JR

[A voir en vidéo sur Futura]

[stefjm]

ceci dit la méthode utilisée pour générer la table est primitive!

Bonsoir,
M'enfin! une vrai méthode industrielle qui marche.