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mémoire ram avec le langage VHDL



  1. #1
    hamza_lahlou

    Smile mémoire ram avec le langage VHDL


    ------

    Salut,
    je veux créer une mémoire de type RAM simple de (8*8) sous le langage VHDL ??
    qlqu'un peut me donner un exemple?
    merci pour votre aide

    -----

  2. #2
    JPL

    Re : mémoire ram avec le langage VHDL

    Je n'ai rien compris, mais le bon forum pour le VDHL c'est Électronique. Message déplacé.
    Rien ne sert de penser, il faut réfléchir avant - Pierre Dac

  3. #3
    Jack

    Re : mémoire ram avec le langage VHDL

    Çà serait bien que tu postes directement dans le forum électronique et pas dans le forum informatique comme c'est pourtant clairement écrit dans les règles participatives de ce forum.

    PS: grillé par speedy JPL

  4. #4
    jiherve

    Re : mémoire ram avec le langage VHDL

    Bonjour,
    il suffit de declarer un type array de la bonne taille et ensuite d'instancier un signal de ce type, cela generera un RAM si le compilateur l'autorise.
    Cependant les fabricants de FPGA offrent des "macro" permettant de faire la meme chose il faut chercher dans la doc utilisateur qui va bien.
    en inférence :http://quartushelp.altera.com/14.0/m...m_inferred.htm
    un exemple d'utilisation de blocs :https://www.altera.com/support/suppo...-ram-sclk.html
    JR
    l'électronique c'est pas du vaudou!

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