Bonsoir à tous,
Premièrement, j'espère ne pas me tromper de section. Le langage VHDL étant un langage de programmation de composants, je ne sais où est véritablement sa place sur ce forum déjà bien fourni en catégories.
Je vous explique,
J'ai, pour un projet, une partie programmation en VHDL à réaliser.
J'ai un signal entrant qui est constitué d'une suite d'impulsions à 40 kHz (10 au totale) puis d'un temps de repos. Ce motif est répété périodiquement.
Mon objectif est de ne garder qu'une petite impulsion au début de cette trame, qui peut représenter alors un start de celle-ci.
Le autres impulsion ne nous intéressent pas.
Mes professeurs m'ont parlé de "piège à 1" et m'ont expliqué comme le mettre en oeuvre.
Néanmoins, je n'y arrive pas. Les résultats de simulation (sur ModelSim je précise) ne me conviennent pas.
Savez vous comment je peux m'y prendre ?
Lorsque cette suite de 10 impulsions commence, je veux générer une petite impulsion, comme un start, représentant le début de celle-ci.
Je vous remercie,
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