Multiplexeur

[invite4c80defd]

Bonjour a tous,

j'ai des exos a faire sur les mulitplexeur/demultiplexeur mais c'est la premiere fois que je rencontre ce type circuit.
Voici celuisur lequel je travaille en ce moment. (c'est en fait le 74LS153)



Beaucoup de questions me sont posées dessus.
En effet, on m'a demandé combien de multiplexeurs 4 vers 1 il possède: j'ai dit deux comme je vois huit entées. On me demande ensuite combien de commandeds d'adresse le ciruit possède. dans un multiplexeur 4 vers 1, il y en a deux je crois mais je crois que ce sont les entrées S0 et S1 ici: iol y aurait que deux qui serviraient pour tout le multiplexeur ? (à en croire les branchements). Enfin,on me demande le rôlme des entrées Ea et Eb mais meme en ayant fait des recherches, j'ignore à quoi elles servent...

Merci pour votre aide
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[invitee05a3fcc]

j'ignore à quoi elles servent...

Tu analyses le circuit logique interne .... et tu en tires les conclusions .

[invite4c80defd]

et bien je dirais qu'elles participent à chaque fois à la derniere porte logique (ET) avec S1 , S0 et une des huit autres entrées mais pourquoi ?
Parce que j'ai une d'un multiplexeur "simple" ( une seul 4 vers 1) et il y a seulement 4 entrées , une sortie et une commande ( deux entrées C0 et C1 qui sont deux adresses bianaires apparemment)

[invitee05a3fcc]

Tu peux aussi lire la spécification du 74xx153 .....
Il y a un texte d'explication et un tableau de fonctionnement.

[A voir en vidéo sur Futura]

[invite4c80defd]

j'ai bien trouvé un ou deux documents la dessus mais pas tres détaillés et en anglais ...
Je vais encore essayer de rechercher des infos

[invitee05a3fcc]

Toutes les datasheet sont en patois AngloSaxon http://www.datasheetcatalog.com/data.../74LS153.shtml

[invite4c80defd]

c'est bien dommage car ça me fait un handicap supplémentaire.
Apparemment, ce sont des "select input", c'est-a-dire , des entrées de sélection ?...

[invitee05a3fcc]

• Sans connaitre une centaine de mots Anglais ..... impossible de faire de l'électronique
• Pour lire un tableau de fonctions logiques ..... pas besoin de connaitre l'Anglais

[invite4c80defd]

d'apres le tableau, sur la premiere ligne, on est sur H puis apres tout le temps sur L. D’après la première ligne, on pourrait croire que c'est une entrée qui impose la sortie mais apres o, est tout le temps sur L et je ne voit en quoi la sortie dépend de cette entrée-ci

[invitee05a3fcc]

d'apres le tableau, sur la premiere ligne, on est sur H puis apres tout le temps sur L. D’après la première ligne,

si l'entrée G est au niveau "1" la sortie est au niveau "0" ...quelque soit l'état des entrées d'adresse ou de données.

[invite4c80defd]

ça serait alors comme un entrée prioritaire qui prend le pas sur toutes les autres ?

[invitee05a3fcc]

ben oui ....

[invite4c80defd]

j'ai rencontré l terme entrée de forçage à un moment , est-ce que c'est ça ou cette expression traite d'autres choses ?

[invitee05a3fcc]

Oui, mais on utilise plutôt le terme "Validation"

[invite4c80defd]

ok merci , je commence à apprendre du vocabulaire et c'est toujours bon à prendre.
Je peux maintenant passer au démultiplexeur...

[invite4c80defd]

Je suis actuellement sur le 74LS155.
j'ai dit qu'il y avait deux démux. dans ce circuit .
Ensuite on me demande "dans quel état sont les sorties non-sélectionnées ?"
Et bien, à première vue, je dirais quelles sont dans l'état H (high) mais ne serait-ce pas plus logique que ce soit le contraire ? (je dit ça sans certitude, je n'y connais pas grand chose pour pas dire rien du tout ..)

[invitee05a3fcc]

On ne va pas passer tout le catalogue TTL en revue ! Tu regardes la datasheet et tu lis le tableau ....

[invite4c80defd]

non non, mes exos concernent uniquement les MUX et DEMUX.
Donc, en lisant la premier ligne, on peut donc conclure qu'elle sont dans l'état H
Je voudrais etre bien sur de comprendre , un H correspondrait à un 1 (je dis peut etre des bétises, si c'est la cas, n'hésitez-pas à ma le dire .)

[invite4c80defd]

Je suis désolé mais je n'arrive pas à comprendre la table de vérité du démultiplexeur: pour les entrées Ea , on complémente Ea^barre et on met tout ça dans un ET avec Ea , mais pourquoi ?

[invitee05a3fcc]

Je suis désolé mais je n'arrive pas à comprendre la table de vérité du démultiplexeur:

Table de vérité ou schéma logique ??????

pour les entrées Ea , on complémente Ea^barre et on met tout ça dans un ET avec Ea ,

Ce que tu expliques n'a rien à voir avec le schéma logique ......

[invite4c80defd]

je parlais bien de la table de vérité ici

[invitee05a3fcc]

je parlais bien de la table de vérité ici

Non, tu parles de n'importe quoi ... pour voir que Ea est complémenté, c'est sur le schéma logique que tu peux voir ça .

[invite4c80defd]

oui mais c'est a partir de la table que l'on peut voir sur quel "état" est Ea (qui est complémentée..) masi je n'arrive pas à en saisir les sens

Merci pour votre aide

[invitee05a3fcc]

Je ne comprend rien à ce que tu racontes ...
Alors, tu me fais une copie écran du tableau ou du schéma dont tu causes .

[invite4c80defd]

Voici ce sur quoi je travaille:

[invitee05a3fcc]

Tu parles de quelle question et/ou de quelle figure ?

[invite4c80defd]

j'étais sur la question 2, deuxieme partie . Mais pour pouvoir répondre du mieux possible, nécessaire d'analyser la table et le schéma situés au dessus de cette question

(dans tous les cas, toutes les questions seront à faire)

[invitee05a3fcc]

j'étais sur la question 2, deuxieme partie .

Et tu réponds quoi ?

[invite4c80defd]

et bien je dirais (mais attention: ce n'est qu'un hypothese) qu'en se basant sur la premiere ligne, les entrées de validation A0 et A1 étant sur un "état indépendant du niveau", que les sorties non sélectionnées sont sur " l'état H", maintenant je me trompe peut-être, comme je vous l'ai dit, je ne connais pas ce genre de circuits

[invitee05a3fcc]

OK

maintenant je me trompe peut-être, comme je vous l'ai dit, je ne connais pas ce genre de circuits

On ne connait pas tous les circuits, mais il faut être capable de lire et d'interpréter !
Question 3 maintenant !