Logique combinatoire : Multiplexeurs

[Komorov]

Salut à tous,
Voilà en fait je ne vois pas trop comment faire des exercices où il y a des multiplexeurs en logique combinatoire...
Tout d'abord on me dit qu'il y a 8 variables et j'ai 3 entrées, à quoi correspondent ces variables (aux différentes sorties?).
De plus je ne vois pas trop comment faire des schémas avec (on me dit utiliser des multiplexeurs et des nand) : j'ai une fonction logique (des ou de produits de 3 variables) mais comment je fais pour traduire ça en MUX? que représente concrêtement le multiplexeur comme fonction logique?
Merci
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[DAUDET78]

Bonjour Komorov et bienvenue sur FUTURA

Tout d'abord on me dit qu'il y a 8 variables et j'ai 3 entrées, à quoi correspondent ces variables (aux différentes sorties?).

Tu as le texte de ton exercice ?

[Komorov]

J'ai fait une erreur, j'ai 8 entrées et 5 variables : A,B,P0,P1,P2
2 fonctions logiques déterminées antérieurement : F1=P0(bar)P1(bar)P2(bar)A + P0(bar)P1(bar)P2 A(bar) + P0(bar)P1(bar)P2 A(bar) + P0(bar)A(bar)B + P0(bar)P1P2A+P0(bar)B(bar)P1A+ P0(bar)B(bar)AP1+B(bar)P2(bar) AP1+A(bar)P1(bar)P0P2+A(bar)P1 (bar)BP0+P1(bar)AP0P2 et une 2e fonction de la même trempe...

"Pour la réalisation du circuit, on utilise une solution à base de MUX, en essayant de minimiser le nombre de boitiers.
Faire la synthese du circuit en utilisant 2 MUX à 8 entrées, un réseau de NAND et des inverseurs." (les sorties sont F1 et F2)

[DAUDET78]

Je te demande le texte ... pas un baratin insipide !

[A voir en vidéo sur Futura]

[Komorov]

"On désire faire la synthese d'une UAL 1bit (A et B) comportant 2 sorties F1 et F2 et 3 entrees de selection P0,P1,P2 (p0 poids faible)
Les 8 valeurs de sorties possibles sont données par le tableau suivant
0 F1=A F2=B
1 F1=A(bar) F2=B(bar)
2 F1=A plus B F2 = report addition
3 F1=A(bar)+B F2=A.B(bar)
4 F1= A(bar).B F2=A.B(bar)
5 F1=A(bar)+B F2=A+B(bar)
6 F1=A ou excl B F2= (A ou excl B)(bar)
7 F1=F2=0

1. A partir du diagramme de Karnaugh de chacune de ces 2 fonctions, ecrire F1 et F2 en 1ere forme normale en minimisant le nombre de termes

2. Pour la réalisation du circuit, on utilise une solution à base de MUX, en essayant de minimiser le nombre de boitiers.
Faire la synthese du circuit en utilisant 2 MUX à 8 entrées, un réseau de NAND et des inverseurs."

[DAT44]

Bonjour,
il suffit d’écrire les équation en fonction NAND, et de multiplexer les résultat avec P0,P1 et P2, ou est la difficulté ?

Pour rappel:
A/=(A.A)/
A.B=(A.B)//
A+B=(A/.B/)/

[Komorov]

ah donc il faut que je mette toute l'expression en produits de produits?
Mais une fois que j'ai ça, qu'est ce que je fais? "où s'arrête le multiplexeur" sur le schéma?

[DAT44]

Bonjour,
en sortie du premier multiplexeur tu a F1, en sortie du deuxième multiplexeur tu a F2,
sur les entrées de chaque multiplexeur tu as les différente équation de F1 et F2 que tu a écrit avec des portes NAND.

Pour rappel, la porte NAND est un opérateur universelle, c'est a dire que n'importe quelle équation, peut être réaliser avec des portes NAND.

[Komorov]

Ah d'accord, merci, j'ai compris! Mais du coup je suis plus sur en fait... Car si j'ai juste à mettre les entrées et à dire que la sortie du multiplexeur est F1/F2, alors que veut-on que je fasse dans la question? J'ai en sortie de mes 2 MUX F1 et F2 mais après?...

[DAT44]

Bonjour,
le travail consiste a ré-écrire les équation avec uniquement des NAND et des NOT
F1(0)=A; F1(1)=NOT(A);F1(2)=NOT(NOT(A). NOT(B)); etc...