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Periode Astable à porte logique CMOS



  1. #1
    blaster91000

    Periode Astable à porte logique CMOS


    ------

    Bonjour, je n'arrive pas à déterminer la période du signal Uc(t) , la tension au borne du condensateur ainsi que le rapport cyclique en fonction de VTH/VDD, R2 et C1, sachant que VTH = VDD/2, c'est la tension à la quelle bascule les portes logiques.

    Voici le schéma :



    J'aimerai savoir si le fait d'alimenté les portes en 5V ou 15V change la valeur de la période ou si cela n'a aucune influence ?

    Merci d'avance pour votre aide

    -----

  2. Publicité
  3. #2
    Gérard

    Re : Periode Astable à porte logique CMOS

    Es-tu sûr de ton schéma ?

    Le 40106 est un boitier contenant 6 inverseurs avec entrées en trigger de Schmitt.
    Pour avoir 1 oscillateur avec 1 inverseur :
    C entre entrée et masse
    R entre entrée et sortie

  4. #3
    blaster91000

    Re : Periode Astable à porte logique CMOS

    Oui je suis certains enfaite j'ai mis ce symbole mais j'ai pas de composant précis, j'ai 3 inverseurs, avec comme tension de basculement VTH = VDD/2. J'ai pas plus d'info sur le composant à par que c'est un CMOS ! Merci d'avoir répondu

  5. #4
    abracadabra75

    Re : Periode Astable à porte logique CMOS

    Bonjour.
    je ne sais si tu expérimentes, ou fais un exercice dit d' école.
    Dans le premier cas, pour un multivibrateur, la porte U1:A (ou B, peu importe) est de trop car elle supprime le déphasage nécessaire à l' oscillation.

    Pour un oscillateur à trigger de Schmitt, seuls U1:C, C1 et R2 sont nécessaires, le point commun à U1 et C1 étant à la masse, la sortie étant au point commun C1,R2.

    A+
    Il n'y a que dans le dictionnaire où 'réussite' vient avant 'travail'.

  6. A voir en vidéo sur Futura
  7. #5
    blaster91000

    Re : Periode Astable à porte logique CMOS

    Citation Envoyé par abracadabra75 Voir le message
    Bonjour.
    je ne sais si tu expérimentes, ou fais un exercice dit d' école.
    Dans le premier cas, pour un multivibrateur, la porte U1:A (ou B, peu importe) est de trop car elle supprime le déphasage nécessaire à l' oscillation.

    Pour un oscillateur à trigger de Schmitt, seuls U1:C, C1 et R2 sont nécessaires, le point commun à U1 et C1 étant à la masse, la sortie étant au point commun C1,R2.

    A+
    Enfaite ce sont de simple inverseur avec une tension de basculement de VDD/2 j'ai mis trigger de schmitt pq j'avais que sa sous la main !

  8. #6
    blaster91000

    Re : Periode Astable à porte logique CMOS

    Personne ne peut m'aider ?

  9. Publicité
  10. #7
    Tropique

    Re : Periode Astable à porte logique CMOS

    Tu peux partir de ceci:
    http://www.fairchildsemi.com/an/AN/AN-118.pdf
    Après, tu peux calculer les instants caractéristiques à partir des tensions d'alim, seuils et les fonctions exponentielles aux bornes du RC.
    Tu pourras vérifier tes calculs en comparant aux valeurs numériques données.
    Pas de complexes: je suis comme toi. Juste mieux.

  11. #8
    blaster91000

    Re : Periode Astable à porte logique CMOS

    merci mais cela ne m'aide pas beaucoup, j'applique la formule
    t = R.C ln ((Uf - Ui)/(Uf - Uo)) mais calculer le temps de décharge du condo ce me donne pour la partie entre parenthése quelque chose de négatif alors que le log népérien de prend pas les nombres négatif donc il doit y avait un probléme quelque part.

  12. #9
    Tropique

    Re : Periode Astable à porte logique CMOS

    Tu dois mal évaluer les tensions aux différents instants. Voici la façon de réfléchir: pour les commutations, l'armature du bas de C1 (V5) va toujours se trouver à Vth: c'est le seuil de la porte qui est en V1, et se retrouve en V5 quand il n'y a pas de courant dans R1.
    Au moment des commutations, V3 se trouvera à Vdd ou Vss, selon la polarité; V4 est dans l'état opposé. Tu dessines le circuit équivalent, en tenant compte éventuellement des diodes de protection d'entrée, et tu calcules le (ou les ) temps, tu dois arriver à qque chose de cohérent.
    Pas de complexes: je suis comme toi. Juste mieux.

  13. #10
    blaster91000

    Re : Periode Astable à porte logique CMOS

    C'est exactement comme cela que j'ai réfléchi, voila ce que j'ai trouvé Tc = Temps de charges et Td = Temps de décharge :

    Tc = R2.C1 ln ( (VDD - VTH)/(VDD + VTH))

    cela est correct normalement c'est pour Td le probléme :

    Td = R2.C1 ln ((0 - VTH)/(0 + VTH))


    Pour précision, les portes sont alimentées en 0 - 15 V soit 0 - VDD

    Est-ce que tu vois une erreur dans mes formules ?

  14. #11
    blaster91000

    Re : Periode Astable à porte logique CMOS

    Personne ne peut m'aider ?

  15. #12
    Tropique

    Re : Periode Astable à porte logique CMOS

    Comme les situations sont symétriques, Tc=Td. Il faut raisonner du point de vue du condo pour les tensions, pas en valeur absolue référencée à la masse: ta première formule est correcte, et si tu mets les bons signes, tu dois arriver au même résultat pour l'autre alternance.
    Pour le circuit, et le condo en particulier, 15V ou 0V, ça ne veut rien dire, c'est toi qui mets les conventions. Si tu décides que VDD=0V et que VSS=-15V, tu dois encore arriver au même résultat. C'est un bon exercice.
    Pas de complexes: je suis comme toi. Juste mieux.

  16. Publicité
  17. #13
    blaster91000

    Re : Periode Astable à porte logique CMOS

    J'applique le mm principe pour Td que pour Tc mais j'y arrive pas ! Puis si Tc =Td ca veut dire que le rapport cyclique est de 50% donc j'en déduis que T = 2.R2.C1 ln 3 ?

  18. #14
    Tropique

    Re : Periode Astable à porte logique CMOS

    Citation Envoyé par blaster91000 Voir le message
    J'applique le mm principe pour Td que pour Tc mais j'y arrive pas ! Puis si Tc =Td ca veut dire que le rapport cyclique est de 50% donc j'en déduis que T = 2.R2.C1 ln 3 ?
    C'est ça. Attention que selon le type de porte, il faut éventuellement tenir compte des diodes de protection d'entrée, et donc de R1.
    Pas de complexes: je suis comme toi. Juste mieux.

  19. #15
    sisi94

    Re : Periode Astable à porte logique CMOS

    pouvez vous m'aider a faire la partie D de cette page svp.je vous serai trés reconaissant. merci d'avance j'ai vraiment personne pour m'aider donc je compte sur vous. voici l'onglet:
    http://lmc.ac-grenoble.fr/~ncolmont/...eslogiques.pdf
    et voici mon adresse e-mail titi1600@hotmail.fr

  20. #16
    Jack
    Modérateur

    Re : Periode Astable à porte logique CMOS

    Bonjour sis94.

    Merci de respecter les règles du forum. Tout d'abord la chart précise qu'il ne faut pas fournir d'adresse email dans les discussions. Les mp sont la pour ça.

    Et ensuite, ceci pour poster des images.
    http://forums.futura-sciences.com/el...-sabonner.html

    Ca évitera de tomber sur des liens morts comme ça vient de m'arriver avec celui de ton message précédent.

  21. #17
    sisi94

    Re : Periode Astable à porte logique CMOS

    je suis vraiment désolé de ne pas avoir respécté la régle je n'avais pas bien lu charte et je suis sincérement désolé.
    en ce qui concerne le lien je me suis trompé en recopiant.
    voila le bon lien:
    lmc.ac-grenoble.fr/~ncolmont/MPI/porteslo/Coursporteslogiques.pdf
    Je m'exuse pour le dérangement causé. c'est la partie D que je n'arrive pas a faire.
    Merci de me répondre le plus rapidement possible svp, c'est vraiment urgent. Merci d'avance.

  22. #18
    Gérard

    Re : Periode Astable à porte logique CMOS

    Le lien ne marche pas.

  23. Publicité
  24. #19
    sisi94

    Re : Periode Astable à porte logique CMOS

    si il marche il suffit de le copier et de le coller dans la barre d'adresse.

  25. #20
    sisi94

    Re : Periode Astable à porte logique CMOS

    si il marche il suffi de le copier et de le coller dans la barre d'adressse
    le revoila:
    lmc.ac-grenoble.fr/~ncolmont/MPI/porteslo/Coursporteslogiques.pdf
    c'est la partie D que je n'arrive pas a faire. Merci de votre aide.

  26. #21
    Jack
    Modérateur

    Re : Periode Astable à porte logique CMOS

    Comme ça c'est mieux
    Fichiers attachés Fichiers attachés

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