Différence entre conception et modélisation des système intégrés ?

[MedYak]

SVP

c'est quoi la différence entre conception et modélisation des système intégrés ?

merci infiniment .
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[Antoane]

Bonjour,

C'est fondamentalement différent.
En conception, le but est de réaliser un dispositif répondant à un cahier des charges.

Exemple simpliste : le cahier des charges étant "Comment générer une tension continue de 12 V sous 200 mA max à partir du secteur ?", le concepteur va décider (par exempel) d'utiliser un transformateur 230/10 V; suivit d'un pont de diodes, d'une capacité de filtrage dont il calculera la valeur, etc.

La modélisation consiste à trouver un modèle d'un truc qui existe ou qui pourrait exister (ou parfois même qui n'existera jamais). Un modèle étant un ensemble de relations décrivant certaines propriétés considérées comme intéressantes du truc considéré.

Exemple : ce dispositif là :

communément appelé "résistance bobinée de puissance à support céramique de 4.7 Ohm - 10 W - 2 %", pourrait être modélisé comme suit :
- ou bien un composant dont la relation entre la tension à ses bornes et le courant la traversant vaut U=R*I ;
- ou bien une association résistance - inductance ;
- ou bien une association résistance - inductance - capacité ;
- ou bien une association résistance - inductance - résistance - inductance (mettant en lumière les pertes par fonction de la fréquence) ;
- ou bien un modèle résistance thermique - capacité thermique (si c'est la thermuique du composant qui t'intéresse) ;
- ou bien un parallélépipède de dimensions 9*9*45 mm^3 si c'est l'encombrement du composant qui est ici intéressant,
- etc.
Le modèle utilisé dépendant du domaine d'intérêt (électrique, thermique, etc. ) et du degré de finesse recherché (modèle R, RL, RLC, RLRL, etc. )

Sachant que concevoir requière a priori un peu de modélisation, fut-elle triviale.

[MedYak]

Merci Antoane, j'apprécie ta réponse détaillée.
Mais s'il te plait tu peux me donner un exemple en relation avec la modélisation et la conception des systèmes par VHDL ?
Merci.

[Antoane]

Je t'invite à en proposer un, qqn corrigera si besoin.

[A voir en vidéo sur Futura]

[jiherve]

Bonsoir,
En VHDL on commence par concevoir la fonction désirée et ensuite on simule car les modèles existent normalement de facto et cette simulation se fera à trois niveaux:
1 : le fonctionnel ,on vérifie que la fonction conçue fait bien ce que l'on attends.
2: le temporel ,on vérifie que la fonction conçue fonctionne bien à la fréquence souhaitée et que les signaux qui en sont issus correspondent bien au cahier des charges.
3: par une simulation électrique ,il faut les modèles IBIS des I/O du FPGA, on vérifie que tout çà est encore vrai sur la future carte.
C'est un métier!
JR