Probleme en verilog
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Probleme en verilog



  1. 05/05/2010, 21h42 #1
    inviteba9166d5

    Probleme en verilog


    ------

    bonjour

    Voila , j'ai une question de programmation en verilog. J'ai l'impression que c'est simple mais je ne sais pas pourquoi, je n'arrive pas a compiler ça.

    J'ai un compteur "cpt", deux horloges CLK1 et CLK2 et un bouton "B"

    Lorsque B=0
    cpt=cpt+1 a chaque front montant de CLK1

    lorsque B=1
    cpt continue a s'incrementer cpt=cpt+1 mais au rythme de CLK2 plus rapide et ignore CLK1

    Puis lorsqu'on revient à B=0, on reprend le comptage sur le rythme de CLK1


    quelqu'un a t il une idée pour coder cela.

    merci d'avance

    -----
  2. 05/05/2010, 22h20 #2
    Jack
    Modérateur

    Re : Probleme en verilog

    Aucun rapport avec l'informatique.

    Transféré en électronique.
  3. 06/05/2010, 00h34 #3
    invite7a49d0d5

    Cool Re : Probleme en verilog

    Bonjour,

    faut prendre un crayon et du papier...
    pour dessiner des chrono- et orga-nigrames...
    delà c'est de la logique...

    mais je comprends mal le fonctionnement désiré...

    vede
    ;O]
    ____________________
    ...
  4. 08/05/2010, 08h45 #4
    invite0258f73f

    Re : Probleme en verilog

    Pense d'abord à decrire un multiplexeur entre les 2 horloges.
    Ensuite, il ne te restera plus qu'à compter au rythme de cette horloge multiplexée.
    Mais attention au changement de dommaine quand tu passes d'une horloges à une autre !
  5. Aujourd'hui
    A voir en vidéo sur Futura
« Reset PIC18F | implémenter sur fpga un circuit écrit en vhdl »

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