Problème de décodage logique...
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Problème de décodage logique...



  1. #1
    invitea12d4c3d

    Question Problème de décodage logique...


    ------

    Bonjour à Tous...

    Après avoir testé plusieurs solutions à base de portes logiques de base, de bascules, etc...,
    j'ai pas trouvé de solution à mon problème que que voici.

    J'ai réalisé un compteur 16bits avec un CD4516.

    Je voudrais en ressortir 2 bits complémentaire à chaque fois qu'il compte jusqu'à 16.

    Je m'explique :

    Le compteur démarre 0,1,2,..,15 : Bit1 =0 / Bit2 =1 (premier comptage)

    Le compteur continue 0,1,2,..,15 : Bit1 =1 / Bit2 =0 (deuxième comptage)

    Le compteur continue 0,1,2,..,15 : Bit1 =0 / Bit2 =1 (troisième comptage)

    Le compteur continue etc...

    Quelqu'un aurait t-il une solution avec un petit shémas pour m'aider ?

    Merci...

    -----

  2. #2
    invite550e8a93

    Re : Problème de décodage logique...

    Bonsoir,
    Je te réponds vite,mais il me semble que si tu utilises la sortie carry out (pin 7) et que tu l'envoie sur l'entrée ck d'un second 4516,tu dois pouvoir récupérer ces infos sur les sorties Q1 et Q2 . Sauf que tu auras Q1 =1 et Q2 = 1 au troisième comptage.Soit tu t'es trompé dans ta description,soit bit 2 est toujours le complémentaire de bit 1 d'après ce que tu as écrit .
    A+

  3. #3
    invite936c567e

    Re : Problème de décodage logique...

    Bonsoir

    Tu peux régler le problème avec une simple bascule D issue d'un boîtier 4013.

    Il suffit de relier :
    - la sortie -TC (Terminal Count, pin #7) du 4516 à l'entrée CL (Clock, pin #3) du 4013
    - la sortie -Q (Inverted Output, pin #2) à l'entrée D (Data Input, pin #5) du 4013
    - l'entrée -R (Reset, pin #4) du 4013 à la masse (GND ou Vss), ou bien à la sortie d'un circuit de remise à zéro (signal inversé par rapport à MR (Master Reset) du 4516)
    - l'entrée -S (Set, pin #6) du 4013 à la masse (GND ou Vss)
    - toutes les entrées de la seconde bascule non utilisée du 4013 (pins #8 à #11) à la masse (GND ou Vss).

    Dans cette configuration, la sortie Q (Output, pin #1) correspond à ton signal Bit1, et la sortie -Q (Inverted Output, pin #2) correspond à ton signal Bit2.

  4. #4
    invitea12d4c3d

    Re : Problème de décodage logique...

    Bonsoir PA5CAL... Et merci ça fonctionne nickel.

  5. A voir en vidéo sur Futura

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